EDA课程实验报告
----移位相加8位硬件乘法器电路计
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移位相加硬件乘法器设计
一．实验目的
1、学习移位相加8 位硬件乘法器电路设计；
2、学习应用EDA 技术进行项目设计的能力
二．实验原理
该乘法器是由8位加法器构成的以时序方式设计的8位乘法器。其乘法原理是：乘法通过逐项移位相加原理来实现，从被乘数的最低位开始，若
为1，则乘数左移后与上一次的和相加；若为0，左移后以全零相加，直至被乘数的最高位。
实验箱内部结构图
：
三．实验设备
1.安装QUARTUS II 软件的PC一台；
2.实验箱一个 四．实验步骤
1.输入下列VHDL程序：
2.编译程序，并连接实验箱并下载 3.在实验箱上按下列要求进行设置：
①选择模式1 ②CLKK控制移位相加速度，接clock0=4Hz ③A[7..0]、B[7..0]输入数据 显示于此4个数码管上
④DOUT[15..0]接数码管8/7/6/5，显示16位乘积：PIO31—PIO16 ⑤接键8（PIO49）：高电平清0，低电平计算允许
⑥A[7..0]接键2/1，输入8位乘数 PIO7—PIO0 （模式1） ⑦B[7..0]接键2/1，输入8位被乘数 PIO7—PIO0 （模式1）
五．实验结果
实验程序编译运行后RTL电路图
ou 1） 2
（模式
实验RTL电路
A[7..0]接键2/1，输入8位乘数：A2（十六进制） B[7..0]接键4/3，输入8位被乘数：33（十六进制） 可得结果DOUT[15..0]：2046（十六进制） 六：心得体会
通过电子设计的数字部分EDA设计，我们掌握了系统的数字电子设计的方法，也知道了实验调试适配的具体操作方法。
通过实验，进一步加深了对EDA的了解，让我对它有了浓厚的兴趣。但是在调试程序时，遇到了不少问题，编译下载程序时，总是有错误，在细心的检查下，终于找出了错误和警告，排除困难后，程序编译就通过了，心里终于舒了一口气。
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